PCIe 6.0（PCI Express 6.0）
PCIe 第六代协议 — 单 lane 64 GT/s，x16 双向带宽 256 GB/s，相比 PCIe 5.0 再次翻倍。是支持 CXL 3.0 / 下一代 eSSD / GPU 互联的关键互联协议（据3-05）。
是什么
- 协议：PCI-SIG 2022 年正式发布的 PCIe 6.0 标准
- 速率：单 lane 64 GT/s（PAM4 编码）
- x16 带宽：256 GB/s（双向），是 PCIe 5.0 的 2 倍、PCIe 4.0 的 4 倍
- 核心创新：从 NRZ 切换到 PAM4 调制（同一时钟传 2 bit）+ FLIT 模式 + 前向纠错（FEC）
- 互连协议演进：CXL 3.0 物理层即 PCIe 6.0
关键应用
- 下一代 eSSD：PCIe 6.0 SSD 顺序读写突破 28 GB/s
- GPU 互联：替代 NVLink 部分场景（开放标准）
- CXL 3.0 / 3.1：基于 PCIe 6.0 物理层
- AI 服务器主板：连接 CPU / GPU / DPU / SmartNIC
产业链玩家
- 协议主导：PCI-SIG
- Retimer/Switch：Astera Labs / 澜起科技 / Broadcom / Microchip
- 早期采用：NVIDIA / AMD / 主流 CSP
关键趋势
- 2026-27 大规模量产 — 早期样片已出，目标在下一代 AI 服务器平台落地
- Retimer 用量翻倍 — 高速度下信号损耗加剧，每条 lane 多 1-2 颗 Retimer
- 生态从 PCIe 5.0 向 PCIe 6.0 滚动 — CXL 2.0 (PCIe 5.0) → CXL 3.0 (PCIe 6.0)
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